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FPGA DRAM数据错位

3198 FPGA DRAM

问答对人有帮助，内容完整，我也想知道答案 0 使用NI的 FPGA，开辟了一个1294*1040大小的DRAM，在60HZ帧频下按地址一个MCK一个地址的刷新DRAM中的数据，也就是每个地址刷新时间不到17微秒，一开始出现一个数据都写不进去，我通过实验发现DRAM刷新数据有延迟，这个是任何资料都没有写到的，我通过奇偶间隔刷新方式解决了，但连续刷新数据超过54个时钟整个DRAM就会出现整体错位情况，请问DRAM还有什么特性我不知道会导致此现象？ 0 已退回40积分
2018-11-7 23:57:30　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × Lynn3080 该类别下有 31 个回答。邀请回答 chenbingjy 该类别下有 27 个回答。邀请回答 yoonssica 该类别下有 22 个回答。邀请回答 houxiaoxiao 该类别下有 17 个回答。邀请回答小萃米该类别下有 16 个回答。邀请回答小工兵该类别下有 16 个回答。邀请回答 Elecfans管家该类别下有 15 个回答。邀请回答我爱妖妖该类别下有 14 个回答。邀请回答言尽于此33 该类别下有 14 个回答。邀请回答 haozix521 该类别下有 14 个回答。邀请回答 hxing 该类别下有 13 个回答。邀请回答平漂流该类别下有 13 个回答。邀请回答那些年儿ing 该类别下有 13 个回答。邀请回答 chenjian050 该类别下有 12 个回答。邀请回答小麦地该类别下有 12 个回答。邀请回答科比如我该类别下有 12 个回答。邀请回答倪love 该类别下有 12 个回答。邀请回答 xiekaboy 该类别下有 12 个回答。邀请回答 tutu1583 该类别下有 11 个回答。邀请回答 2013crazy 该类别下有 11 个回答。邀请回答举报林长清相关推荐 • NI FPGA 3004 • 关于FPGA外部的DDR3 DRAM怎么回事 2523 • 请问FPGA采集ADC用uPP发送到C6748如何保证数据与AD通道对应？ 1312 • FPGA读写DRAM存储器的代码 7281 • 为什么v6 FPGA不能通过DDR-800 DRAM进行信号完整性仿真？ 959 • BRAM，DRAM和DMA之间的区别是什么 6796 • FPGA实验板内存问题 4348 • spi中断接收模式**扰后数据会一直错位 9907* • 请教用数字模拟电路（非单片机）设计一个能检测数据线错位的电路？ 1312 • 请问Labview读取CSV文件后数据错位是什么原因造成的？如何解决？ 2852 3个回答

答案对人有帮助，有参考价值 0 是不是线连错了！！！！！！！！！！！

2018-11-22 10:52:06 评论举报王王

答案对人有帮助，有参考价值 0 你说的“刷新“的意思是写数据吗？奇偶间隔刷新方式是什么意思，我不太理解你的说法。一般对于DRAM写地址和写数据是对齐的，而在读的时候根据你对IP核的设置读数据一般至少会比读地址晚一拍

2018-11-24 23:15:55 2 评论举报 fisker 2 条评论林长清 2018-11-26 11:39 “刷新“的意思是按地址往DRAM里写数据,地址和数据是一一对齐的，一开始写正常，但连续写一会（54MCK）后DRAM整体就开始错位了赞回复举报林长清 2018-11-26 11:40 之前写入正常的也都错位赞回复举报

答案对人有帮助，有参考价值 0 已经解决了，知道原因了，已经解决了，知道原因了，

2018-12-10 20:07:24 评论举报林长清

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